FPGA項目實戰系列課程--圖形圖像處理應用方向 |
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通過本期培訓使學員能夠精通基于FPGA硬件設計方法,運用verilog語言設計JPEG編碼器和H.264數據壓縮處理模塊,在掌握HDL硬件設計基本技巧后,對圖像視頻處理有深刻的認識。同時對ASIC設計有一定的了解。 |
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理工科類大專以上學歷;喜歡并有志投身于IT事業;具備一定硬件知識;了解Verilog HDL硬件描述語言。 |
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每期人數限3到5人。 |
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上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈 最近開課時間(周末班/連續班/晚班):圖像處理開班時間:2020年3月16日 |
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◆課時: 共5天,36個學時 ☆注重質量 ☆邊講邊練 ☆合格學員免費推薦工作 |
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◆團體報名優惠措施:兩人95折優惠,三人或三人以上9折優惠 |
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1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽; |
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第一部分 JPEG2000
FPGA設計理論與實踐
1. JPEG標準概述 1.1 圖象技術基礎 2. JPEG DCT模塊概述與實踐 3. JPEG 量化模塊概述與實踐 4. JPEG 熵編碼模塊概述與實踐 5. JPEG 總體設計與仿真 第二部分 H.264視頻處理 FPGA 設計理論與實踐 1. H.264標準學習與研究 1.1 運動圖象處理的基本技術 2. H.264中圖像預處理De-interlace HDL設計實踐 3. H.264中圖像預處理中值濾波 HDL 設計實踐 |